COD. 332 - FPGA: Field programmable Gate Arrays - Panoramica sulle tecniche per una progettazione allo stato dell’arte 2024 - 6 dic
CFP: 6
In presenza
109
posti disponibili
Prezzo per iscritti: GRATUITO
Prezzo per esterni: GRATUITO
Ora: 09:00
Durata: 8.00 Ore
La commissione ELETTRONICA e MICROELETTRONICA istituita presso l’Ordine degli Ingegneri della Provincia di Roma, propone agli iscritti un seminario tecnico gratuito sul tema della progettazione elettronica mediante l’uso dei cosiddetti FPGA (Field Programmable Gate Arrays) components. Si analizzeranno alcune tipologie di FPGA adatte per progetti negli ambiti Industriale, Biomedicale, Trasporti, Difesa ed Aerospazio. La prima parte riguarderà una panoramica introduttiva e preparatoria degli argomenti a seguire, attraverso la quale si illustrerà al discente (neofita od esperto che sia) cos’è, dove e come si usa e soprattutto come si sceglie un FPGA; si affronteranno poi alcune tecniche di utilizzo di questi componenti nelle loro più classiche configurazioni (con o senza un processore al loro interno o collegato ad essi) cercando di fornire al discente una strategia per ridurre il più possibile il tempo necessario alla progettazione di soluzione tecnicamente complesse. Saranno presentate diverse soluzioni ponendo gli FPGA al centro della discussione, siano essi agenti in versione stand-alone che in versione SoC (System on Chip). I discenti avranno anche l’opportunità di valutare diverse tipologie di componente e di strumenti di progettazione, in modo che possano essere poi in grado di scegliere la soluzione FPGA + tool di progettazione che meglio si adatta alle loro esigenze di progetto.
Durante il seminario si avrà anche modo di studiare alcune soluzioni FPGA che consentono di realizzare sistemi SAFETY CRITICAL e AI (Artificial Intelligence) con l’ausilio di diverse tipologie di processore (ARM™ o RISC-V™), in versione SoftCore e/o HardCore.
Nella parte iniziale del seminario sarà presentata un’introduzione al mondo delle FPGA per i neofiti, in modo che possano anche loro meglio apprezzare i contenuti che saranno proposti durante l’intera giornata.
Nota: alcuni argomenti saranno trattati in lingua Inglese.
Ore 9:00 – 09:15
Registrazione dei partecipanti
Ore 9:15 – 09:30
Saluti iniziali e introduzione ai lavori.
Ing. Massimo Cerri
Presidente Ordine degli Ingegneri della Provincia di Roma
Ing. Pier Francesco Maria Santi
Presidente Commissione Elettronica e Microelettronica Ordine degli Ingegneri della Provincia di Roma
I° parte
Ore 09:30 – 10:30
Panoramica introduttiva.
“FPGA: cosa sono, a cosa servono, come si usano e come si scelgono”
Ing. Pier Francesco Maria Santi
Presidente Commissione Elettronica e Microelettronica Ordine degli Ingegneri della Provincia di Roma
Ore 10:30 – 11:30
“Soluzioni di Edge Processing basate su FPGA e SoC per sistemi Safety Critical"
Ing. Luca Cattaneo
Ordine degli Ingegneri della provincia di Varese
EMEA FPGA Team Manager (Microchip)
Ore 11:30 – 12:00
Pausa/Coffe break
Ore 12:00 – 13:00
"Linux e funzionalità operative RealTime su piattaforme RISC-V™ Multicore su FPGA"
Ing. Luca Cattaneo
Ordine degli Ingegneri della provincia di Varese
EMEA FPGA Team Manager (Microchip)
Ore 13:00 – 14:30
Pausa pranzo
II° parte
Ore 14:00 – 15:00
Designing with FPGA’s HIGH-SPEED interfaces
Ing. Francesco Contu
HS and RF system solution expert EMEA (Silica/AMD)
Ore 15:00 – 16:00
Multichannel and multichip synchronization (RF_Soc multi antenna design)
Ing. Francesco Contu
HS and RF system solution expert EMEA (Silica/AMD)
Ore 16:00 – 16:30
Pausa/Coffe break
Ore 16:30 – 17:30
“Disruptive Quantum™ Architecture for Efinix™ mainstream FPGAs”
Dipl. Ing.(FH) Harald Werner
EMEA FPGA Team Manager (Efinix)
Ore 17:30 – 18:30
“Efinix™ IP and free license Design Software (RISC-V, IP and AI solutions)”
Dipl. Ing.(FH) Harald Werner
EMEA FPGA Team Manager ( Efinix)
Ore 18:30 – 18.45
Domande, chiusura lavori e saluti finali
Ing. Pier Francesco Maria Santi
Presidente Commissione Elettronica e Microelettronica Ordine degli Ingegneri della Provincia di Roma
Dipl. Ing.(FH) Harald Werner
EMEA FPGA Team Manager (Efinix)
Giorno | Inizio | Fine | Sede | Docenti |
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06-12-2024 | 09:00 | 18:45 | Sede Ordine degli Ingegneri della provincia di Roma |